四则运算小计算器设计过程实录-Verilog FPGA数字系统设计入门学习日记 版权信息
- ISBN:9787512419582
- 条形码:9787512419582 ; 978-7-5124-1958-2
- 装帧:暂无
- 册数:暂无
- 重量:暂无
- 所属分类:>>
四则运算小计算器设计过程实录-Verilog FPGA数字系统设计入门学习日记 本书特色
本书以日记的形式记录了一个可实现四则运算计算器的设计过程,从而达到学习fpga设计的目的。全书共10章,讲述了从设计开始到完成的全过程,其中包括数码管显示、键盘扫描、状态机等基础模块的设计,以及设计中需要注意的问题等,每一章的*后还有夏宇闻老师对本章内容的点评及给读者的学习建议。 希望读者按顺序阅读本书,同时进行实践操作,并与书中的进度保持一致,*终完成整个设计。读者也可以根据自己的想法来实现想要的功能,做到举一反三,以达到*好的学习效果。书中使用的硬件为至芯科技的四代开发板、altera cyclone iv的芯片,软件为quartus ii 13.0 sp1。 本书可作为电子工程类、自动控制类、计算机类的大学本科高年级学生及研究生设计实验参考用书,亦可供其他工程人员自学与参考。
四则运算小计算器设计过程实录-Verilog FPGA数字系统设计入门学习日记 内容简介
在仔细阅读这本书之前,请读者务必先看这本书的目录。看到它的与众不同了吗? 《四则运算小计算器设计过程实录——verilog fpga数字系统设计入门学习日记》一书*神奇的地方就在于它记录的完全是作者赵然的学习体会,书中没有华丽的辞藻,没有过多的修饰,有的是完全的、毫无保留的探索过程中的经验分享。四则运算小计算器的设计不是什么大型设计,但读者们透过这个设计,可以掌握fpga系统设计的精髓,它虽然只是“一块砖”,但哪座大厦不是由一块块平淡无奇的“砖”盖起来的呢? 如果您想10天就跨入fpga系统设计的大门,这本书可以带您实现理想。准备好您的板子,跟着赵然和夏宇闻教授的讲解,动手吧!
四则运算小计算器设计过程实录-Verilog FPGA数字系统设计入门学习日记 目录
四则运算小计算器设计过程实录-Verilog FPGA数字系统设计入门学习日记 作者简介
赵然,首都师范大学光学工程硕士,曾在夏宇闻老师指导下学习Verilog数字系统设计三个月,美国国家仪器(NI)认证CLAD工程师。擅长数字逻辑设计,现任中国科学院计算技术研究所(ICT)工程师,从事FPGA开发工作。
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