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魂芯数字信号智能处理器系统与应用设计

作者：朱家兵，黄光红，林广栋

出版社：科学出版社出版时间：2024-01-01

开本： B5 页数： 268

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魂芯数字信号智能处理器系统与应用设计版权信息

ISBN：9787030767592
条形码：9787030767592 ; 978-7-03-076759-2
装帧：平装胶订
册数：暂无
重量：暂无
所属分类：
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魂芯数字信号智能处理器系统与应用设计内容简介

本书选定是目前业界近期新高性能的智能处理器魂芯V-A，该处理器是在十三·五期间国家重大专项的支持下，由中国电子科技集团公司研制的一款异构多核高性能智能处理器，该处理器集成了4个RISC-V的CPU核和4个NNA核。本书重点介绍了魂芯V-A智能处理器的基本工作原理，包括处理器内核结构、存储器组织、中断服务、时钟管理、系统加载、系统配置、指令集系统设计等。此外，本书也详细介绍了魂芯V-A智能处理器的程序设计和应用系统设计，对设计中应该注意的问题也进行了详细的说明。本书为读者提供了大量的设计实例，适用于雷达、通信、导航、智能分拣设备、太赫兹安检、智能化生产线监控、智慧园区、交通智能监控等领域。

魂芯数字信号智能处理器系统与应用设计目录

目录前言第1章魂芯数字信号智能处理器简介11.1 魂芯数字信号智能处理器概述11.1.1流水线简介21.1.2数据格式31.2 BWDSP100的组织结构41.2.1运算部件41.2.2程序控制器51.2.3地址发生器61.2.4内部存储器71.2.5外设71.3 BWDSP100开发简介91.3.1多处理器耦合91.3.2BWDSP100时钟域介绍131.3.3FLASH编程141.3.4引导141.3.5工作模式21第2章存储空间定义及寄存器232.1 存储空间定义232.2 寄存器242.2.1全局控制寄存器242.2.2内核执行单元控制与标志寄存器252.2.3DMA控制寄存器372.2.4中断控制寄存器522.2.5定时器控制寄存器642.2.6通用I/O控制寄存器652.2.7并口配置寄存器702.2.8UART控制寄存器712.2.9DDR2控制器的配置寄存器732.2.10数据存储器读写冲突标志寄存器116第3章中断及异常1183.1 中断向量表1183.2 中断类型1203.3 内部中断1203.3.1定时器中断1203.3.2DMA中断1213.3.3串口中断1213.3.4软件中断1223.4 外部中断1223.5 中断控制寄存器1223.5.1中断锁存寄存器1223.5.2中断屏蔽寄存器1233.5.3中断指针屏蔽寄存器1233.6 中断服务1233.7 中断返回1253.8 异常125第4章链路口1284.1 综述1284.1.1链路结构1284.1.2链路I/O引脚1284.1.3发送和接收数据1294.2 链路口通信协议1304.2.1链路口传输协议1304.2.2并串转换电路1314.2.3串并转换电路1324.3 错误检测机制1334.3.1发送端错误检测1334.3.

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